使用Digilent FPGA板资源中心进行数字设计
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本书使用了超过75个例子，向您展示如何开始在VHDL或Verilog®中设计数字电路，模拟它们，并快速和轻松地下载到您的Basys, Nexys 2，或Nexys 3板。从基础的7段显示，内存，VGA端口，PS/2端口，和更多的快速运行-一步一步，通过示例!
在过去的十年里，数字设计发生了一场重大的革命。现场可编程门阵列(fpga)现在可以包含超过100万个等效逻辑门和数万个触发器。这意味着，当数字电路可能包含数千个门时，不可能使用传统的逻辑设计方法，包括绘制逻辑图。事实上，今天的数字系统是通过以硬件描述语言(hdl)的形式编写软件来设计的。目前最常用的hdl是VHDL和Verilog。两者都被广泛使用。当使用这些硬件描述语言时，设计者通常描述逻辑电路的行为，而不是写传统的布尔逻辑方程。计算机辅助设计工具用于模拟VHDL或Verilog设计，并将设计综合到实际硬件中。
这本书假设之前没有数字设计的知识。你从最开始学习基本的门、逻辑方程、布尔代数和卡诺图开始。在超过75个示例中，我们向您展示如何使用VHDL或Verilog设计数字电路，使用Aldec active hdl模拟器模拟它们，并在Basys, Nexys 2或Nexys 3 FPGA板上将设计合成到Xilinx®Spartan™-3E FPGA上。Aldec Inc (www.aldec.com)提供了一个免费的学生版Active-HDL模拟器。要将您的设计合成到Spartan-3E或Spartan-6 FPGA，您需要从Xilinx (www.xilinx.com)下载免费的ISE WebPACK™。从Aldec Active-HDL集成中调用Xilinx合成工具GUI．我们将使用Adept 2实用程序将您的综合设计下载到Xilinx FPGA。Adept 2.8.1软件套件可从Digilent, Inc.免费下载。