使用Digilent FPGA板资源中心的数字设计简介
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这本书使用了30个例子来展示你如何开始在VHDL或Verilog®中设计数字电路，使用框图，模拟它们，并快速和轻松地下载到您的Basys或Nexys 2板。站起来，并快速运行-一步一步，通过例子!
过去十年，数字设计领域发生了一场重大变革。现场可编程门阵列(fpga)现在可以包含100多万个等价逻辑门和数万个触发器。这意味着，当数字电路可能包含数千门时，不可能使用包括绘制逻辑图的传统逻辑设计方法。现实是，今天的数字系统是通过以硬件描述语言(hdl)的形式编写软件来设计的。目前最常用的hdl是VHDL和Verilog。两者都得到了广泛的应用。当使用这些硬件描述语言时，设计者通常描述逻辑电路的行为，而不是编写传统的布尔逻辑方程。计算机辅助设计工具用于模拟VHDL或Verilog设计，并将设计综合到实际的硬件。
本书假设没有先前的数字设计知识。我们将使用Aldec的Active-HDL来设计、模拟、合成和实现我们的数字设计。Aldec公司(www.aldec.com)提供了一个免费的Active-HDL模拟器学生版。将您的设计合成到Spartan-3E FPGA，您将需要从Xilinx®Inc. (www.xilinx.com)下载免费ISE WebPACK™。Xilinx合成工具是从Aldec Active-HDL集成中调用的GUI．我们将使用ExPort实用程序将您的综合设计下载到Spartan3E FPGA。ExPort是你可以从Digilent, Inc.免费下载的Adept软件套件的一部分。