Cora Z7基本I/O演示
描述
这个项目是一个使用Cora Z7的RGB的Vivado演示领导's和按钮,用Verilog写的。
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当编程到板上,RGB led将循环从蓝色到绿色到红色到关闭
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只要按下两个按钮中的一个,就对应RGB领导将被关闭
库存
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Cora Z7与MicroUSB编程电缆
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Vivado安装与此演示(2020.1)的最新版本兼容
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看到安装Vivado, Vitis和勤勉板文件安装说明。
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下载及使用说明
首先,发行版(由一组供下载的文件组成)只与特定版本的Xilinx工具兼容,这在发行版的名称中指定(称为版本标记).此外,版本仅与该板的指定版本兼容。例如,Zybo Z7标记为“20/DMA/2020.1”的发布版本仅适用于-20版本的电路板和Vivado 2020.1。
这个演示的最新版本用绿色高亮显示。
注意:在2020.1之前发布的FPGA演示版本使用了不同的git结构,并使用了不同的版本标签命名方案。
董事会变体 | 版本标记 | 版本下载 | 设置说明 |
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科拉Z7-07S | 07年年代/ Basic-IO / 2020.1 - 1 | ZIP下载发布 | 看到使用最新版本,低于 |
科拉Z7-10 | 10 / Basic-IO / 2020.1 - 1 | ZIP下载发布 | 看到使用最新版本,低于 |
科拉Z7-07S | v2018.2-1 | ZIP下载发布 | v2018.2-1 Github的自述 |
科拉Z7-10 | v2018.2-1 | ZIP下载发布 | v2018.2-1 Github的自述 |
科拉Z7-07S | 2017.4 - 1 | ZIP下载发布 | 2017.4 - 1 Github的自述 |
科拉Z7-10 | 2017.4 - 1 | ZIP下载发布 | 2017.4 - 1 Github的自述 |
高级用户注意事项:所有的演示为Cora Z7提供通过Cora-Z7在Github库。关于这个存储库结构的更多文档可以在这个wiki上找到Digilent FPGA Demo Git库页面。
最新版本的使用说明可以在下拉菜单中找到:
- 使用最新版本
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注意:这个工作流在许多Digilent FPGA演示中都很常见。截图可能与您正在使用的演示不匹配。
重要的是:这些步骤仅适用于Xilinx工具版本2020.1及以后的版本。旧版本可能需要其他流,如发布表中所述。
首先,从上面链接的演示版本页面下载并解压'*.xpr.zip'文件。
- 从一个版本打开一个Vivado项目
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发射Vivado
- 建立一个Vivado项目
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生成一个比特流
为了创建一个可用于对目标板编程的文件,需要运行“编译管道”的每个阶段。
这开始于合成.鉴于XDC文件中包含的约束条件,Synthesis创建逻辑门的描述以及它们之间执行HDL文件所描述的功能所需的连接。要运行Synthesis,请单击其中之一在工具栏或在流导航器.然后,Synthesis的输出被传递给Implementation。
实现有几个步骤。总是运行的步骤是选择设计(优化设计以适应目标FPGA),地方的设计(在目标FPGA结构中布局设计),并且路线设计(路由信号通过fabric)。要运行实现,单击其中之一在工具栏或在流导航器.然后将输出传递给Bitstream Generator。
的比特流发生器生成FPGA编程所需的最终输出文件。要运行比特流生成,请单击其中之一在工具栏或在流导航器.没有改变设置,生成器将创建一个'。一些文件。
根据设计的复杂性、使用的电路板和计算机的强度,构建项目的过程可能需要5到60分钟。完成后,将出现一个弹出对话框,提示您从几个选项中选择一个。没有一个与本指南的目的相关,所以单击取消.“write_bitstream complete”状态消息可以在窗口的右上角看到,这表明演示已经准备好部署到你的板上了。
- 设置科拉Z7
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将Cora Z7通过microUSB编程电缆插入计算机。
功能
RGB led
按钮
额外的资源
所有与Cora Z7使用相关的材料都可以在其上找到资源中心.
要了解在Vivado中创建一个简单HDL项目的过程,请参见入门Vivado专为硬件设计.关于重要部分的信息GUI,以及在硬件中修改、重新构建和运行该演示所需的间接讨论也可以在这里找到。
如需技术支持,请访问FPGA“勤奋论坛”的部分。