数字设计介绍使用DigInent FPGA Boards资源中心
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本书使用30个示例来向您展示如何在VHDL或Verilog®中开始设计数字电路，并使用框图，模拟它们，并快速，并轻松地将其下载到您的Basys或Nexys 2板上。按逐步启动和运行 - 逐步运行！
在过去十年中发生了数字设计的重大革命。现场可编程门阵列（FPGA）现在可以包含超过一百万的等效逻辑门和数万个触发器。这意味着当数字电路可能包含数千个门时，不可能使用涉及逻辑图的传统逻辑设计方法。现实是，今天的数字系统是通过以硬件描述语言（HDL）的形式写软件来设计的。今天使用的最常见的HDL是VHDL和Verilog。两者都在广泛使用。使用这些硬件描述时，设计者通常描述逻辑电路的行为而不是编写传统的布尔逻辑方程。计算机辅助设计工具用于模拟VHDL或Verilog设计，并将设计合成为实际硬件。
本书假设没有以前的数字设计知识。我们将使用Active-HDL从ALDEC进行设计，模拟，综合和实施我们的数字设计。Aldec Inc（www.aldec.com）提供Active-HDL模拟器的免费学生版本。o将您的设计合成给Spartan-3E FPGA，您需要从Xilinx®Inc.（www.xilinx.com）下载免费的ISE WebPack™。从Aldec Active-HDL内部调用Xilinx综合工具吉伊。我们将使用导出实用程序将合成设计下载到Spartan3e FPGA。导出是Adept Software Suite的一部分，您可以免费下载Digilent，Inc。